| Item type |
テクニカルレポート / Technical Report_02(1) |
| 公開日 |
2023-05-26 |
| タイトル |
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タイトル |
論理最適化手法を用いた消費電力の低減化手法 |
| タイトル |
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タイトル |
Power Reduction Method by Logic Optimization Techniques |
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言語 |
en |
| 言語 |
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言語 |
jpn |
| キーワード |
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主題 |
論理最適化 |
| キーワード |
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主題 |
トランスダクション法 |
| キーワード |
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主題 |
消費電力 |
| キーワード |
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主題 |
信号値遷移確率 |
| キーワード |
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主題 |
部分回路抽出 |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_18gh |
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資源タイプ |
technical report |
| 著者 |
上田, 祐彰
樹下, 行三
UEDA, Hiroaki
KINOSHITA, Kozo
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
論理最適化手法であるトランスダクション法を応用して論理回路の平均消費電力を低減化する手法を提案する.提案手法は,平均消費電力が低減するなら,リテラル数,トランジスタ数が減少しない場合でも回路変換を実行するため,通常の論理最適化以上の電力削減が期待できる.また,消費電力低減化の可能性のある部分回路を抽出し,抽出された部分回路に対して消費電力低減化手法を適用することにより,大規模回路に対する適用を可能にした.部分回路の抽出法には,共通な遷移的入力を持ったゲートをより多く抽出するためのファンアウト指向抽出法と,各信号線を中心に一定規模の部分回路を抽出する距離指向抽出法の2手法について考察し,実験結果を提示する. |
| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
This paper presents a power reduction method which reduces the average power dissipation using transduction method. The method transforms the circuit into a circuit whose power dissipation is lower than that of original, even if the number of literals or transistors may be increased due to the transformation. Thus, it is expected that power reduction capability of this method is very high. Next, we apply the power reduction method for large circuits by sub-circuit extraction. Two extraction methods are described. The one is fanout-oriented extraction and the other is distance-oriented extraction that. For both methods, experimental results for benchmark circuits are also reported. |
| 書誌情報 |
情報処理学会研究報告. 設計自動化研究会報告
巻 95,
号 99,
p. 129-135
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| 出版者 |
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出版者 |
情報処理学会 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AN1011091X |
| 論文ID（NAID） |
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関連タイプ |
isIdenticalTo |
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識別子タイプ |
NAID |
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関連識別子 |
110002930586 |
| 権利 |
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権利情報 |
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| 権利 |
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| 権利 |
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権利情報 |
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| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ipsj.or.jp/ |
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関連名称 |
情報処理学会 |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
110002930586.pdf (546.2 kB)
