| Item type |
テクニカルレポート / Technical Report_02(1) |
| 公開日 |
2023-05-26 |
| タイトル |
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タイトル |
次世代の高速大容量シリアルリンクアーキテクチャの提案 |
| タイトル |
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タイトル |
Proposal for Next Generation High Speed Serial Link Architecture |
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言語 |
en |
| 言語 |
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言語 |
jpn |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_18gh |
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資源タイプ |
technical report |
| 著者 |
弘中, 哲夫
土江, 竜雄
HIRONAKA, Tetsuo
TSUCHIE, Tatsuo
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
今後LSI内外のバスは動作速度向上に伴って高速化するが, それとともに配線遅延が問題化する. つまり, 従来のバスではすべてのバス配線間での信号到着の同時性を保証することが難しく, 従来のバス・アーキテクチャではスキューの保証が困難になる. 本稿では従来のシリアルリンクの利点を採り入れる事により, 伝送遅延が大きく信号到着の同時性が保証できない状況下であっても対応可能な大容量高速バスアーキテクチャである SPBusを提案する. SPBusは従来のバスアーキテクチャに比べ, 必要なバンド幅に応じて配線数を増減できる柔軟なバス・アーキテクチャである. |
| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
As the I/O bus speed of LSI grows faster, the more the bus line delay cause trouble. For high speed bus we can not except all signals to reach the receivers within the same clock, that means bus line skew would cause trouble. In this paper we propose a new skew proof bus architecture with the ability to achieve scalable high band width by increasing the number of bus lines. |
| 書誌情報 |
情報処理学会研究報告. 計算機アーキテクチャ研究会報告
巻 97,
号 102,
p. 31-36
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| 出版者 |
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出版者 |
情報処理学会 |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
0919-6072 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AN10096105 |
| 論文ID（NAID） |
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関連タイプ |
isIdenticalTo |
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識別子タイプ |
NAID |
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関連識別子 |
110002775149 |
| 権利 |
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権利情報 |
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| 権利 |
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| 権利 |
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権利情報 |
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| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ipsj.or.jp/ |
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関連名称 |
情報処理学会 |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
110002775149.pdf (518.7 kB)
