| Item type |
テクニカルレポート / Technical Report_02(1) |
| 公開日 |
2023-05-26 |
| タイトル |
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タイトル |
スーパスカラ・プロセッサ用データ・キャッシュの実現方式の検討 |
| タイトル |
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タイトル |
Study of Implimentation Method of Data Cache for Superscalar Processors |
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言語 |
en |
| 言語 |
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言語 |
jpn |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_18gh |
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資源タイプ |
technical report |
| 著者 |
佐々木, 敬泰
土江, 竜雄
弘中, 哲夫
児島, 彰
SASAKI, Takahiro
TSUCHIE, Tatsuo
HIRONAKA, Tetsuo
KOJIMA, Akira
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
スーパスカラ・プロセッサでは, スーパスカラ度に見合う十分なデータ供給バンド幅を確保するため, ロード/ストア・ユニットの多重化を行う. しかし同一サイクルに多重度分のロード/ストア命令を実行できなければ多重化したロード/ストア・ユニットに見合った性能向上は望めない. そこで, 複数のロード/ストア命令に対応できるマルチポートのデータ・キャッシュの実現方式について検討する. |
| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
To achieve enough data bandwidth balanced with superscalar degree, the load/store units must be multiplied. However if we don't have enough data bandwidth to process the load/store instructions provided by the multiple load/store unit every clock cycle, the multiplied load/store unit will be useless. This paper discuss the technique to implement multiport data cache that supplies enough bandwidth for multipled load/store requests. |
| 書誌情報 |
情報処理学会研究報告. 計算機アーキテクチャ研究会報告
巻 96,
号 80,
p. 215-220
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| 出版者 |
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出版者 |
情報処理学会 |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
0919-6072 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AN10096105 |
| 論文ID（NAID） |
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関連タイプ |
isIdenticalTo |
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識別子タイプ |
NAID |
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関連識別子 |
110002775362 |
| 権利 |
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権利情報 |
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| 権利 |
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| 権利 |
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権利情報 |
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| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ipsj.or.jp/ |
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関連名称 |
情報処理学会 |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
110002775362.pdf (383.9 kB)
