| Item type |
テクニカルレポート / Technical Report_02(1) |
| 公開日 |
2023-05-26 |
| タイトル |
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タイトル |
強可検査性に基づくデータパスのテストプラン生成アルゴリズムの改良について |
| タイトル |
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タイトル |
An Improvement of the Test Plan Generation Algorithm for Strongly Testable Datapaths |
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言語 |
en |
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言語 |
jpn |
| キーワード |
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主題 |
階層テスト |
| キーワード |
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主題 |
強可検査性 |
| キーワード |
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主題 |
データパス |
| キーワード |
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主題 |
テストプラン |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_18gh |
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資源タイプ |
technical report |
| 著者 |
岡本, 直己
市原, 英行
井上, 智生
細川, 利典
藤原, 秀雄
OKAMOTO, Naoki
ICHIHARA, Hideyuki
INOUE, Tomoo
HOSOKAWA, Toshinori
FUJIWARA, Hideo
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
大規模集積回即こ対するテスト生成を効率よく行う方法として,階層テスト生成法[2]がある.本研究では,階層テスト容易化設計法である,強可検査性に基づくレジスタ転送レベルデータパスのテスト容易化設計法[3]の改良について考察する.従来法[3]を構成する手続きの1つである制御林生成アルゴリズムに着目し,生成される制御経路のタイミング衝突(1つの外部入力から,1つのモジュールの異なる2つの入力までの制御経路の順序深度が等しいこと)の発生を回避するヒューリスティックアルゴリズムを提案する.この結果,ホールド機能を付加するレジスタ数を削減することができる.さらに,モジュールの入力に接続されたレジスタの情報をタイミング衝突の尺度で表現することで,提案するアルゴリズムが,従来法[3]の制約条件を満たさないデータパスに対しても, 有効なテストプランを生成可能であることを示す.実験により,提案するヒューリスティックアルゴリズムが,追加するホールド機能(ハードウエアオーバヘッド)およびテスト実行時間を削減できることを示す. |
| 書誌情報 |
情報処理学会研究報告. SLDM, [システムLSI設計技術]
巻 2003,
号 120,
p. 43-48
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| 出版者 |
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出版者 |
情報処理学会 |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
09196072 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AA11451459 |
| 権利 |
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権利情報 |
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| 権利 |
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| 権利 |
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権利情報 |
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| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ipsj.or.jp/ |
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関連名称 |
情報処理学会 |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
110002687599.pdf (645.2 kB)
