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  1. テクニカルレポート
  2. 情報処理学会研究報告
  3. SLDM, [システムLSI設計技術]

閉塞網を用いたバンクベース多ポートメモリの構成と回路規模評価

https://hiroshima-cu.repo.nii.ac.jp/records/1742
https://hiroshima-cu.repo.nii.ac.jp/records/1742
0110fb9b-f540-4a0e-a899-eec365600877
名前 / ファイル ライセンス アクション
110002687637.pdf 110002687637.pdf (539.4 kB)
Item type テクニカルレポート / Technical Report_02(1)
公開日 2023-05-26
タイトル
タイトル 閉塞網を用いたバンクベース多ポートメモリの構成と回路規模評価
タイトル
タイトル Construction and Evaluation of Bank-based Multi-port Memory using Blocking Network
言語 en
言語
言語 jpn
キーワード
主題 多ポートメモリ
キーワード
主題 多バンクメモリ
キーワード
主題 閉塞網
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者 井上, 智宏

× 井上, 智宏

井上, 智宏

ja-Kana イノウエ, トモヒロ

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弘中, 哲夫

× 弘中, 哲夫

弘中, 哲夫

ja-Kana ヒロナカ, テツオ

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佐々木, 敬泰

× 佐々木, 敬泰

佐々木, 敬泰

ja-Kana ササキ, タカヒロ

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小出, 哲士

× 小出, 哲士

小出, 哲士

ja-Kana コイデ, テツシ

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マタウッシュ, ハンス ユルゲン

× マタウッシュ, ハンス ユルゲン

マタウッシュ, ハンス ユルゲン

ja-Kana マタウッシュ, ハンス ユルゲン

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INOUE, Tomohiro

× INOUE, Tomohiro

en INOUE, Tomohiro

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HIRONAKA, Tetsuo

× HIRONAKA, Tetsuo

en HIRONAKA, Tetsuo

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SASAKI, Takahiro

× SASAKI, Takahiro

en SASAKI, Takahiro

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KOIDE, Tetsushi

× KOIDE, Tetsushi

en KOIDE, Tetsushi

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MATTAUSCH, Hans Jurgen

× MATTAUSCH, Hans Jurgen

en MATTAUSCH, Hans Jurgen

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抄録
内容記述タイプ Abstract
内容記述 メモリのアクセスバンド幅の向上のために多バンク型多ポートメモリが用いられることがある.一般的にこの手法ではプロセッサとバンクメモリ間の結合にクロスバが用いられる.しかしながら,ポート数,バンク数が大きくなるとクロス八部分のチップ面積が増大し,大きなポート数を持つメモリが実現できない問題がある.そこで,本稿ではプロセッサとバンクメモリ間の結合に閉塞網を用いた多バンク型多ポートメモリを提案する.トランジスタ数による評価の結果,提案手法は従来手法の10%〜20%程度のトランジスタ数で実現できることがわかった.
抄録
内容記述タイプ Abstract
内容記述 Using bank-based mult-ports memory is one of the methods to achieve high memory access band width. It is common to use crossbar network which is based on non-blocking network for combination between the processors and a memory in the conventional bank-based mult-sports memory system. However. there is a problem that the chip area of crossbar network becomes extremely large to increase the number of ports and banks. This report propose a compact bank-based multi-ports memory with blocking network. According to the evaluation results, the proposal method scceeded in reducing number of transistors to 10%〜20% from the conventional method.
書誌情報 情報処理学会研究報告. SLDM, [システムLSI設計技術]

巻 2003, 号 120, p. 271-276
出版者
出版者 情報処理学会
ISSN
収録物識別子タイプ ISSN
収録物識別子 0919-6072
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA11451459
論文ID(NAID)
関連タイプ isIdenticalTo
識別子タイプ NAID
関連識別子 110002687637
権利
権利情報 ここに掲載した著作物の利用に関する注意:本著作物の著作権は(社)情報処理学会に帰属します。本著作物は著作権者である情報処理学会の許可のもとに掲載するものです。ご利用に当たっては「著作権法」ならびに「情報処理学会倫理綱領」に従うことをお願いいたします。
権利
権利情報 The copyright of this material is retained by the Information Processing Society of Japan (IPSJ). This material is published on this web site with the agreement of the author (s) and the IPSJ. Please be complied with Copyright Law of Japan and the Code of Ethics of the IPSJ if any users wish to reproduce, make derivative work, distribute or make available to the public any part or whole thereof. All Rights Reserved, Copyright (C) Information Processing Society of Japan.
権利
権利情報 本文データは学協会の許諾に基づきCiNiiから複製したものである。
関連サイト
識別子タイプ URI
関連識別子 http://www.ipsj.or.jp/
関連名称 情報処理学会
フォーマット
内容記述タイプ Other
内容記述 application/pdf
著者版フラグ
出版タイプ VoR
出版タイプResource http://purl.org/coar/version/c_970fb48d4fbd8a85
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Ver.1 2023-07-25 10:33:18.729964
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