| Item type |
テクニカルレポート / Technical Report_02(1) |
| 公開日 |
2023-05-26 |
| タイトル |
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タイトル |
ディジットシリアル浮動小数点演算器を用いた高精度FFT回路の設計検討 |
| タイトル |
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タイトル |
Consideration of high precision FFT logic with digit-serial floating point unit |
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言語 |
en |
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言語 |
jpn |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_18gh |
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資源タイプ |
technical report |
| 著者 |
鈴木, 圭介
浅生, 宗隆
窪田, 昌史
谷川, 一哉
弘中, 哲夫
SUZUKI, Keisuke
ASAO, Munetaka
KUBOTA, Atsushi
TANIGAWA, Kazuya
HIRONAKA, Tetsuo
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
本稿では, 演算器ベースの再構成デバイスを目指し, 従来のパラレル浮動小数点演算器よりも集積度を高くすることのできるディジットシリアル浮動小数点演算器を提案する.ディジットシリアル浮動小数点演算器の初期評価として, 最もきびしい条件のディジット幅1としたディジットシリアル浮動小数点演算器を使ったFFT回路とパラレル浮動小数点演算器を使ったFFT回路を面積当たりのFlopsで比較した.1ビット幅ではパラレル浮動小数点演算器の方がよい性能であったが, ディジット幅を2以上にした場合にはディジットシリアル浮動小数点演算器の性能がよくなる可能性がある. |
| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
In this paper, we propose a digit-serial floating point unit (FPU) to realize a reconfigurable device based on function units. This paper presents a digit-serial FPU can be implemented in a smaller area than a traditional parallel FPU. We compare a Flops per area of a FFT logic with one bit-serial FPUs to a FFT logic with the parallel FPUs. Though the parallel FPUs is better than one bit-serial FPUs, the digit-serial FPUs might be better than the parallel FPUs. |
| 書誌情報 |
情報処理学会研究報告. 計算機アーキテクチャ研究会報告
巻 2005,
号 120,
p. 33-38
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| 出版者 |
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出版者 |
情報処理学会 |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
09196072 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AN10096105 |
| 権利 |
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権利情報 |
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| 権利 |
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| 権利 |
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権利情報 |
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| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ipsj.or.jp/ |
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関連名称 |
情報処理学会 |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
110003482874.pdf (534.5 kB)
