| Item type |
テクニカルレポート / Technical Report_02(1) |
| 公開日 |
2023-05-26 |
| タイトル |
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タイトル |
ディジットシリアル演算器を用いたFIRフィルタの設計と初期評価 |
| タイトル |
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タイトル |
Initial Evaluation of FIR Filter Based on Digit-Serial Computation |
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言語 |
en |
| 言語 |
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言語 |
jpn |
| キーワード |
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主題 |
ディジットシリアル |
| キーワード |
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主題 |
ビットシリアル |
| キーワード |
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主題 |
FIRフィルタ |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_18gh |
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資源タイプ |
technical report |
| 著者 |
山辺, 裕樹
谷川, 和也
弘中, 哲夫
YAMABE, Yuhki
TANIGAWA, Kazuya
HIRONAKA, Tetsuo
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
FIRフィルタを従来手法であるパラレル演算器を用いて設計した場合,フィルタ長や演算ビット幅を大きくするとハードウェア資源を使いすぎるという問題があった.そこで本稿では,高精度なFIRフィルタを可能な限り小面積で実現する方法として,ディジットシリアル演算器を用いた手法を紹介し,従来手法との比較評価を行った. |
| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
Increasing the filter-length and bit-width of the FIR filter designed using the conventional parallel operation units, will experience a rapid increase in hardware resources. Therefore, we introduce digit-serial operation units on implementing a FIR filter, as a method to implement a high precision FIR with a long filter-length. With the digit-serial operation units, we can keep the required hardware resources of the FIR filter small. In this paper, we evaluated the difference of the FIR filter using the bit-serial operation units between the conventional one as initial evaluation one. |
| 書誌情報 |
情報処理学会研究報告. SLDM, [システムLSI設計技術]
巻 2007,
号 114,
p. 67-72
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| 出版者 |
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出版者 |
情報処理学会 |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
09196072 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AA11451459 |
| 権利 |
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権利情報 |
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| 権利 |
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権利情報 |
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| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ipsj.or.jp/ |
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関連名称 |
情報処理学会 |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
110006533264.pdf (743.8 kB)
