| Item type |
学術雑誌論文 / Journal Article(1) |
| 公開日 |
2023-02-28 |
| タイトル |
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タイトル |
オンチップマルチプロセッサ用共有キャッシュの実現方式の検討とその性能面積評価 |
| タイトル |
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タイトル |
Chip Size and Performance Evaluations of Shared Cache for On-chip Multiprocessor |
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言語 |
en |
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言語 |
jpn |
| キーワード |
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主題 |
オンチップマルチプロセッサ |
| キーワード |
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主題 |
キャッシュアーキテクチャ |
| キーワード |
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主題 |
共有キャッシュ |
| キーワード |
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主題 |
性能評価 |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_6501 |
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資源タイプ |
journal article |
| 著者 |
佐々木, 敬泰
井上, 智宏
大森, 伸彦
弘中, 哲夫
マタウシュ, ハンス ユルゲン
小出, 哲士
SASAKI, Takahiro
INOUE, Tomohiro
OMORI, Nobuhiko
HIRONAKA, Tetsuo
MATTAUSCH, Hans Jurgen
KOIDE, Tetsushi
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
半導体技術の発達により,1チップ上に複数のプロセッサやキャッシュメモリ等を集積するオンチップマルチプロセッサの実現が可能となってきている.共有メモリ型マルチプロセッサはプログラムの記述が容易という利点があるが,一般に各プロセッサに付随するキャッシュの一貫性処理をハードウェアで行う必要があり,これがボトルネックとなってプロセッサの性能を十分に引き出せない危険性がある.また,各プロセッサのキャッシュ間でデータの重複が生じるため,キャッシュメモリを有効に利用できないという問題がある.これらの問題を低減する方法として,各プロセッサで一つのキャッシュを共有する共有キャッシュ方式がある.しかしながら,共有キャッシュをマルチポートメモリセル方式のマルチポートメモリで実現した場合,1ポートメモリと比較してチップ面積がポート数の2乗に比例して増加する.例えば0.5μm CMOSプロセスを用いて8台からなるマルチプロセッサを設計した場合,従来の分散キャッシュで128 kByteのキャッシュを実現できるチップ面積を利用しても,マルチポートセル方式の共有キャッシュでは16 kByteの容量しか確保できないため,高い性能が得られない危険性がある.そこで,本論文ではマルチポートメモリセル方式と比較して面積の小さいマルチバンクメモリ方式のマルチポートメモリを用いることで面積性能効率の高い共有キャッシュが実現できることを示す.評価の結果,マルチバンクメモリ方式を用いることで,従来のマルチポートセル方式の共有キャッシュで16 kByteの容量を実現できるチップ面積を用いて64 kByteの共有キャッシュを実現でき,また分散キャッシュやマルチポートセル方式の共有キャッシュと比較して性能が高いことが分かった. |
| 書誌情報 |
電子情報通信学会論文誌. D-I, 情報・システム, I-情報処理
巻 J87-D-I,
号 3,
p. 350-363,
発行日 2004-03-01
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| 出版者 |
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出版者 |
電子情報通信学会 |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
0915-1915 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AA11341020 |
| 論文ID（NAID） |
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関連タイプ |
isIdenticalTo |
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識別子タイプ |
NAID |
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関連識別子 |
110003171311 |
| 権利 |
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権利情報 |
copyright©2004 IEICE |
| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ieice.org/jpn/trans_online/index.html |
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関連名称 |
http://www.ieice.org/jpn/trans_online/index.html |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
J87-D1_3_350.pdf (567.0 kB)
