| Item type |
学術雑誌論文 / Journal Article(1) |
| 公開日 |
2023-02-28 |
| タイトル |
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タイトル |
K出力可能な閉そく網と非閉そく網を階層的に用いたバンク型マルチポートメモリの構成と評価 |
| タイトル |
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タイトル |
Evaluation of a Hierarchical Bank Based Multi-Port Memory Architecture Using a Multiple Outlets Blocking Network as an Upper Hierarchy and a Non Blocking Network as a Lower Hierarchy |
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言語 |
en |
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言語 |
jpn |
| キーワード |
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主題 |
マルチポートメモリ |
| キーワード |
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主題 |
バンクメモリ |
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主題 |
相互結合網 |
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主題 |
チップ面積 |
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主題 |
アクセスバンド幅 |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_6501 |
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資源タイプ |
journal article |
| 著者 |
井上, 智宏
浅生, 宗隆
弘中, 哲夫
谷川, 一哉
小出, 哲士
マタウシュ, ハンス ユルゲン
INOUE, Tomohiro
ASAO, Munetaka
HIRONAKA, Tetsuo
TANIGAWA, Kazuya
KOIDE, Tetsushi
MATTAUSCH, Hans Jurgen
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| 抄録 |
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内容記述タイプ |
Abstract |
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内容記述 |
マルチポートメモリを現実的なチップ面積で実現する方法として相互結合網と複数のバンクメモリを用いるバンク型マルチポートメモリがある.バンク型マルチポートメモリでは同一バンクに対するアクセス衝突によるランダムアクセスバンド幅の低下を防ぐため,ポート数に比べてバンクメモリの数を多く設定する必要がある.ところがメモリ容量が少ないオンチップシステムへの応用を考えた場合,相互結合網部分のチップ面積がメモリセル部分のチップ面積と比較して相対的に大きくなる危険性がある.そこで,このような問題を解決する一つの方法として,バンク型マルチポートメモリの相互結合網を階層構造化してチップ面積の削減を図る方法が考えられる.しかしながら使用する相互結合網の組合せによるバンク型マルチポートメモリのハードウェア量とアクセスバンド幅との関係が明確になっていない.また単純に階層構造化をすると上位階層と下位階層間のアクセスバンド幅が低下する問題がある.そこで本論文ではこの問題を改善したバンク型マルチポートメモリの構成の提案,及び,階層構造化する相互結合網としてクロスバと閉そく網を用いた場合のバンク型マルチポートメモリのモデル化を行い,ランダムアクセスに対するメモリアクセスバンド幅とトランジスタ数,及び,チップ面積の評価をした.その結果,閉そく網であるEBSFとクロスバを用いて階層構造化する方法がバンド幅に対する面積効率が高いことが分かり,同一のランダムアクセスバンド幅の場合,従来のバンク型マルチポートメモリと比較してチップ面積を約15〜20%小さくできることが分かった. |
| 書誌情報 |
電子情報通信学会論文誌. A, 基礎・境界
巻 J89-A,
号 10,
p. 774-789,
発行日 2006-10-01
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| 出版者 |
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出版者 |
電子情報通信学会 |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
09135707 |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AN10013345 |
| 権利 |
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権利情報 |
copyright©2006 IEICE |
| 関連サイト |
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識別子タイプ |
URI |
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関連識別子 |
http://www.ieice.org/jpn/trans_online/index.html |
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関連名称 |
http://www.ieice.org/jpn/trans_online/index.html |
| フォーマット |
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内容記述タイプ |
Other |
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内容記述 |
application/pdf |
| 著者版フラグ |
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出版タイプ |
VoR |
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出版タイプResource |
http://purl.org/coar/version/c_970fb48d4fbd8a85 |
J89-A_10_774.pdf (1.9 MB)
